数字电路与逻辑设计
石莎 西安电子科技大学
检索结果共
个
1
第一单元
1.1
第一课时
1.2
第二课时
1.3
第三课时
1.4
第四课时
2
第二单元
2.1
第五课时
2.2
第六课时
2.3
第七课时
2.4
第八课时
2.5
第九课时
2.6
第十课时
2.7
第十一课时
2.8
第十二课时
2.9
第十三课时
2.10
第十四课时
2.11
第十五课时
2.12
第十六课时
3
第三单元
3.1
第十七课时
3.2
第十八课时
3.3
第十九课时
3.4
第二十课时
3.5
第二十一课时
3.6
第二十二课时
3.7
第二十三课时
3.8
第二十四课时
3.9
第二十五课时
3.10
第二十六课时
3.11
第二十七课时
3.12
第二十八课时
3.13
第二十九课时
3.14
第三十一课时
3.15
第三十课时
4
第四单元
4.1
第三十一课时
4.2
第三十二课时
4.3
第三十三课时
4.4
第三十四课时
4.5
第三十五课时
4.6
第三十六课时
4.7
第三十七课时
4.8
第三十八课时
5
第五单元
5.1
第三十九课时
5.2
第四十课时
5.3
第四十一课时
5.4
第四十二课时
5.5
第四十三课时
5.6
第四十四课时
5.7
第四十五课时
5.8
第四十六课时
6
第六单元
6.1
第四十七课时
6.2
第四十八课时
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同步时序电路的设计
设计的一般步骤
原始状态图建立过程：输入输出确定，设置状态、明确转移关系
状态化简：等价的判断原则及示例（隐含表化简）
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